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C语言和VHDL语言的区别
1、两个语言没有什么联系。前者是面向硬件的，有点类似单片机。一个是面向软件的，是计算机编程。语法结构没什么大的相似。都是编程语言。如果你要制造一个定时***的定时系统，VHDL适合。
2、后期的FPGA也一样，只是它是基于查找表的。再说C语言：我们可以认为它是用于控制特定电路的工作。我们都知道可以C编程的控制器都有程序存储器，它里面就存放了C编译后的二进制代码。
3、汇编属底层需要。编写时间长工作量大，底层开发驱动开发。C可以适用于大部分开发。vhdl集成电路硬件描述语言，主要是应用在数字电路的设计中。他们的应用环境不同。
4、VHDL是用在FPGA上的，你写完VHDL之后，经过布局布线一系列的过程，最终下到FPGA上，这时候FPGA会构造相应的数字电路（就是用门来实现的），达到你程序的功能。
C语言和汇编语言及VHDL语言的各自的优缺点
1、C语言是结构语言，可读性较强 4：汇编语言基本没有可移植性 C言可移植性很强 5：汇编语言没有函数库，所有代码需要自己组织 C语言有丰富的函数库可供调用。
2、汇编语言：缺点：汇编语言属于低级语言，难理解，编程效率低，编程容易出错。优点：程序执行效率高，占用***少， 方便对最底层的一些东西进行操作。C语言：缺点：危险性高，开发周期长，可移植性不如JAVA。
3、首先说VHDL：它是描述电路的计算机工具，早期的CPLD等器件是基于与-或阵列的，更容易说明这点，VHDL是描述电路行为的，当下载到器件后，它就是具体的电路，这个电路全由与-或阵列组成。
计算机硬件描述语言(VHDL)与编程语言(C语言)的区别及关系,
1、首先说VHDL：它是描述电路的计算机工具，早期的CPLD等器件是基于与-或阵列的，更容易说明这点，VHDL是描述电路行为的，当下载到器件后，它就是具体的电路，这个电路全由与-或阵列组成。
2、VHDL是硬件描述语言，用来做硬件设计的；C语言是软件编程语言，用来编写软件程序的。一个是用来设计硬件系统的，一个是用来设计软件系统的，用途完全不同，不可同日而语。
3、本人刚刚学过VHDL语言，也会C语言。两个语言没有什么联系。前者是面向硬件的，有点类似单片机。一个是面向软件的，是计算机编程。语法结构没什么大的相似。都是编程语言。如果你要制造一个定时***的定时系统，VHDL适合。
4、汇编属底层需要。编写时间长工作量大，底层开发驱动开发。C可以适用于大部分开发。vhdl集成电路硬件描述语言，主要是应用在数字电路的设计中。他们的应用环境不同。
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